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- 恩智浦半導(dǎo)體選擇亞馬遜云科技開啟半導(dǎo)體創(chuàng)新新紀(jì)元
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近日，亞馬遜云科技宣布進(jìn)一步深化與全球知名半導(dǎo)體企業(yè)恩智浦半導(dǎo)體（NXP®Semiconductors）的合作。恩智浦半導(dǎo)體將把其大部分電子設(shè)計自動化（EDA）工作負(fù)載遷移至亞馬遜云科技?；陔p方過去三年的合作，恩智浦半導(dǎo)體將充分利用亞馬遜云科技
2024-10-07 01:56:05
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- 合見工軟與Vector維克多深化戰(zhàn)略技術(shù)合作，高效支持汽車電子系統(tǒng)開發(fā)與測試
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2024年9月11日——上海合見工業(yè)軟件集團(tuán)有限公司（簡稱“合見工軟”）與維克多汽車技術(shù)（上海）有限公司（簡稱“Vector”）共同宣布
2024-09-12 17:41:27
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- 北京大學(xué)校領(lǐng)導(dǎo)率團(tuán)訪問江蘇推進(jìn)校地合作，考察無錫北大EDA研究院
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9月3至4日，北京大學(xué)黨委書記郝平率團(tuán)訪問江蘇省，拜會江蘇省委省政府主要領(lǐng)導(dǎo)，推進(jìn)校地合作事宜；與無錫市委主要領(lǐng)導(dǎo)進(jìn)行工作會談，出席北京大學(xué)長三角未來技術(shù)生命健康研究院啟用儀式
2024-09-09 17:15:58
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- 合見工軟邀您共聚IDAS 2024設(shè)計自動化產(chǎn)業(yè)峰會
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為進(jìn)一步凝聚EDA產(chǎn)業(yè)力量，加速EDA技術(shù)突破和產(chǎn)業(yè)推廣，推動生態(tài)多元化發(fā)展，第二屆設(shè)計自動化產(chǎn)業(yè)峰會IDAS 2024（Intelligent Design Automation Summit 2024）將于2024年9月23日-24日在上?！埥茖W(xué)會堂隆重舉行。
2024-09-02 17:26:05
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- 合見工軟與開源芯片研究院深化戰(zhàn)略技術(shù)合作，賦能“香山”高性能開源RISC-V處理器大型系統(tǒng)構(gòu)建
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2024年8月21日——上海合見工業(yè)軟件集團(tuán)有限公司（簡稱“合見工軟”）與北京開源芯片研究院（簡稱“開芯院”）就“香山”高性能開源RISC-V處理器項目深化戰(zhàn)略技術(shù)合作
2024-08-21 17:15:32
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- 全場景驗證賦能RISC-V開發(fā)，合見工軟邀您共聚第4屆RISC-V中國峰會
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2024年8月21日-23日，第4屆RISC-V中國峰會（RVSC2024）主會和展會將在浙江杭州黃龍飯店舉行。作為國內(nèi)領(lǐng)先的自主創(chuàng)新高性能EDA和工業(yè)軟件解決方案提供商，合見工軟將受邀參展，同時攜一系列硬件產(chǎn)品亮相RVSC 2024，賦能RISC-V系統(tǒng)開發(fā)。
2024-08-21 12:23:56
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- 新思科技創(chuàng)始人Aart de Geus博士獲2024年羅伯特-諾伊斯獎
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近日，新思科技創(chuàng)始人兼執(zhí)行主席Aart de Geus博士獲得2024年半導(dǎo)體行業(yè)最高榮譽羅伯特-諾伊斯獎（Robert N Noyce Award）。
2024-08-16 11:25:00
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- 北京大學(xué)無錫EDA研究院3篇論文入選第61屆設(shè)計自動化會議（DAC）
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來自電子設(shè)計自動化（EDA）與集成電路領(lǐng)域的高校、公司及研究機(jī)構(gòu)群英薈萃，分享了EDA技術(shù)的最新發(fā)展和廣泛應(yīng)用，討論了本領(lǐng)域進(jìn)一步發(fā)展的前景和方向。
2024-07-29 15:10:33
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- 2024年“集成電路先進(jìn)技術(shù)暑期學(xué)?！眻A滿結(jié)業(yè)
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本次暑期學(xué)校自7月23日開始，在新吳區(qū)政務(wù)服務(wù)中心舉行。無錫高新區(qū)黨工委副書記、管委會副主任、新吳區(qū)委常委、副區(qū)長、太科園黨工委書記顧國棟發(fā)表致辭，北京大學(xué)信息科學(xué)技術(shù)學(xué)院副院長、無錫北京大學(xué)電子設(shè)計自動化研究院院長王潤聲
2024-07-29 14:19:30
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- 周向宇院士：加強基礎(chǔ)科學(xué)研究刻不容緩
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周向宇，1965年3月出生，湖南洞口人，數(shù)學(xué)家。2013年當(dāng)選中國科學(xué)院院士；第十四屆全國政協(xié)委員。
2024-07-26 16:38:06
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- IDAS 2024設(shè)計自動化產(chǎn)業(yè)峰會議程揭曉
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為進(jìn)一步凝聚EDA產(chǎn)業(yè)力量，加速EDA技術(shù)突破和產(chǎn)業(yè)推廣，推動生態(tài)多元化發(fā)展，由EDA2主辦，上海市經(jīng)濟(jì)和信息化委員會、上海市浦東新區(qū)人民政府支持，上海電子設(shè)計自動化有限公司
2024-07-22 16:35:37
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- 芯華章生態(tài)戰(zhàn)略亮相DAC，發(fā)布全流程敏捷驗證管理器FusionFlex，并聯(lián)合華大九天推出數(shù)?；旌戏抡娼鉀Q方案
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6月24日，在一年一度的全球電子設(shè)計自動化盛會DAC 2024 上，國內(nèi)領(lǐng)先的系統(tǒng)級驗證EDA解決方案提供商芯華章攜手國內(nèi)EDA龍頭企業(yè)華大九天
2024-06-27 15:47:47
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- 南京郵電大學(xué)+新思科技 | 產(chǎn)教深度融合 理論實踐并行
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6月16日，由南京郵電大學(xué)創(chuàng)新創(chuàng)業(yè)教育學(xué)院、集成電路科學(xué)與工程學(xué)院（產(chǎn)教融合學(xué)院）與新思科技共同主辦的基于新思科技ARC處理器《電子系統(tǒng)設(shè)計創(chuàng)新基礎(chǔ)III》課內(nèi)競賽與ARC處理器嵌入式教學(xué)研討會在南京郵電大學(xué)仙林校區(qū)成功舉行。
2024-06-26 17:19:37
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- 芯華章生態(tài)戰(zhàn)略亮相DAC，發(fā)布全流程敏捷驗證管理器FusionFlex，并聯(lián)合華大九天推出數(shù)模混合仿真解決方案
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6月24日，在一年一度的全球電子設(shè)計自動化盛會DAC 2024 上，國內(nèi)領(lǐng)先的系統(tǒng)級驗證EDA解決方案提供商芯華章攜手國內(nèi)EDA龍頭企業(yè)華大九天，共同展示了雙方在數(shù)?；旌戏抡骖I(lǐng)域的最新聯(lián)合解決方案。
2024-06-26 17:13:14
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- 奇捷科技將于設(shè)計自動化大會（DAC 2024）展示其技術(shù)創(chuàng)新成果——GTECH設(shè)計流程
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奇捷科技（Easy-Logic），作為電子設(shè)計自動化（EDA）領(lǐng)域邏輯功能變更（Functional ECO）解決方案的技術(shù)引領(lǐng)者，將于2024年6月24日-26日美國舊金山舉辦的設(shè)計自動化大會（DAC 2024）展示其最新技術(shù)突破 —— GTECH 設(shè)計流程。
2024-06-20 17:12:07
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- 新思科技推出業(yè)界首款PCIe 7.0 IP解決方案，加速HPC和AI等萬億參數(shù)領(lǐng)域的芯片設(shè)計
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新思科技（Synopsys, Inc ，納斯達(dá)克股票代碼：SNPS）近日宣布，推出業(yè)界首款完整的PCIe 7 0 IP解決方案，包括控制器、IDE安全模塊、PHY和驗證IP。
2024-06-19 17:00:53
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- 北大EDA | HeteroPlace v0.2 版本發(fā)布：重大特性升級！
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物理設(shè)計在數(shù)字集成電路的后端設(shè)計中扮演著至關(guān)重要的角色。它將邏輯綜合后的設(shè)計，即標(biāo)準(zhǔn)單元和互連的圖表示，轉(zhuǎn)化為由邏輯門的物理形狀組成的幾何表示。
2024-05-28 17:29:51
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- 全球半導(dǎo)體競爭加速區(qū)域化重塑
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近期，全球各主要經(jīng)濟(jì)體紛紛在半導(dǎo)體產(chǎn)業(yè)政策方面加力。相較于此前效率優(yōu)先的產(chǎn)業(yè)布局，供應(yīng)鏈的獨立性、多元化和安全性正在逐步成為各國半導(dǎo)體產(chǎn)業(yè)發(fā)展戰(zhàn)略的優(yōu)先考量。
2024-05-27 15:28:41
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- MLSynthesis v1.0 版本發(fā)布：重大特性升級！
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高層次綜合（HLS）技術(shù)正在改變設(shè)計方式。它能夠?qū)⒏邔哟握Z言（如C、C++、SystemC）描述的邏輯結(jié)構(gòu)，轉(zhuǎn)化為低抽象級語言（如Verilog、VHDL、SystemVerilog）描述的電路模型。
2024-05-24 10:46:07
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- MLSynthesis v1.0 版本發(fā)布：重大特性升級！
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高層次綜合（HLS）技術(shù)正在改變設(shè)計方式。它能夠?qū)⒏邔哟握Z言（如C、C++、SystemC）描述的邏輯結(jié)構(gòu)，轉(zhuǎn)化為低抽象級語言（如Verilog、VHDL、SystemVerilog）描述的電路模型。
2024-05-22 17:26:58
